BCD码加法电路图指教 数字电路BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的?

来源：学生作业帮助网 编辑：作业帮 时间：2024/04/29 14:15:15
BCD码加法电路图指教 数字电路BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的?
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BCD码加法电路图指教 数字电路BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的?
BCD码加法电路图指教 数字电路
BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?
已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的?

BCD码加法电路图指教 数字电路BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的?

要知道BCD数是用四位二进制数来表示一位十进制数,那么两位BCD数进行加法时（和的范围是0~18）,当结果超过9时就超过了一位BCD数的表示范围（0~9）,这时需要用两位BCD数来表示该结果.比如3+8=11,用BCD码相加表示为 0011 + 1000 所得结果为1011,显然1011并不在一位BCD码的表示范围内,当给1011加上6（也就是0110时）,得到的结果为 10001,也就是两位BCD数表示的11.

总结,当两位BCD数相加的结果大于9时,需要进行加6修正.

设计该“加6修正逻辑”的过程为：

卡诺图法：五变量的卡诺图,C0 F4 F3 F2 F1.用F表示结果,当F = 1时,表示需要作加6修正.

说明：C0 F4 F3 F2 F1为两位BCD数进行二进制相加后得到的结果（范围为0~18,因此需要5位二进制数来表示）.当C0为1时,也就是说相加结果大于15（在16~18之间）,此时需要加6修正,F = 1.当C0为0时,表示所得结果在0~15之间,这时当结果也大于9时,需要加6修正,F = 1.

由于这里不方便画卡诺图了,就直接上结果：

F = C0 + F4&F3 + F4&F2

对上面的 F 的表达式变换一下就行了,变成只用与非门表示的形式."~" 表示 “逻辑非”

F= ~[~(C0 + F4&F3 + F4&F2)] = ~{ ~C0 & [~(F4&F3)] & [~(F4&F2)] }

BCD码加法电路图指教 数字电路BCD码加法电路图中的 “加6修正电路” 是怎么设计出来的?已知需要一个 “加6修正电路”,但是不知道怎么画,那些与非门怎么设计的? 数字电路中的BCD码2421码是什么意思 设计8421BCD码加法中的校正电路, 一道数字电路题,用T触发器设计一个带进位标志的余3BCD码同步加法计数器,要求列出状态表,求出电路的驱动方程和输出方程.小弟感激涕零! bcd-252mjv电路图 bcd码是什么 什么是压缩BCD码 bcd码的计算 运用VHDL设计1个模为24的8421BCD码加法计数器 FPGA 数电 如何用74160加法计数器 实现 模13BCD码计数器 模13BCD码计数器的真值表如图示求设计的思路, 如何计算BCD码BCD码是不是就是指十进制？ 如何计算8421bcd码 2位BCD码是什么意思 Verilog HDL 模60 BCD码加法计数器 程序段如图所示：为什么要判断高位是否为5? 数字电路基础化简题 Y=AB+AC+BCD+ABD 跪求计算BCD码已知BCD码X、Y,求X+Y、X-Y：（1）X=[00110100]BCD,Y=[00100110]BCD；（2）X=[10011000]BCD,Y=[01000100]BCD；（3）X=[00100111]BCD,Y=[01101001]BCD；（4）X=[01010001]BCD,Y=[10000111]BCD. Verilog实现BCD码加法器,求帮看下我的代码输入的num1,num2是两个加数,out1是输出加法结果的十进制个位数字,out2是输出加法结果的十进制十位数字.（加数为两个四位的8421BCD码,结果也是两个8421BCD 进制转化问题,数字电路十进制数46用8421BCD码表示为?下列最小的数是：A、1100100(2)B、98(10)C、10010111(8421BCD)括号内是下标12位的BCD码可以表示的最大十进制数是?A、B、C是与非门的输入,则输出Y为